112 地方特考三等 電子工程類科 電子學 考古題詳解
第 一 題20 分
有一個雙載子接面電晶體(BJT)差動放大器電路如圖一所示。假設電路在作直流分析時,所有電晶體的基極電流等於 (),且所有的 。電晶體 與 完全匹配,電晶體 的射極-基極接面(E-B junction)面積是電晶體 的 倍。電路中:熱電壓 、。
🖼️【此處有附圖,請對照原卷】
(一)當 ,如果 與 的直流偏壓電流 ,且 ,此時 、 與 的值分別為何?
(二)當 、,若 ,根據(一)所計算出的 與 與直流偏壓,請計算出差動小信號電壓增益
如果 ,請計算出差動放大器 - 的輸入阻抗。
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核心觀念
本題考查:
- BJT 電流鏡與接面面積比例
當 相同時,集極電流與射極-基極接面面積成正比。
- BJT 小信號跨導
- BJT 小信號輸入電阻
(一)計算 、 與
1. 求電流鏡的基準電流
已知
因此差動對的尾電流為
又因為 的 E-B 接面面積是 的 2 倍,且兩者 相同,所以
故
由於題目假設 , 中的電流即為 。
2. 計算 與
兩側電阻上端接至 ,集極電壓為 ,因此
3. 計算
的射極接至 ,因此其基極電壓為
所以 兩端電壓為
故
(二)差動小信號電壓增益
1. 求 BJT 跨導
在靜態工作點,
因此
由於 ,所以
不需考慮 Early effect。
2. 差動模式下的輸出電壓
輸入為
第 二 題20 分
圖二為一個使用 2 個運算放大器(operational amplifier, op amp)的權重加法器(weighted summer)電路。在此電路中,、、、、。
🖼️【此處有附圖,請對照原卷】
(一)如果這 2 個運算放大器均為理想放大器,請計算 。
(二)如果這 2 個運算放大器的增益 均為 ,且輸入阻抗均為無限大,請計算 。
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核心觀念
本題考查兩級反相運算放大器電路:
- 理想運算放大器具有虛短路,且輸入端電流為零:
- 有限開迴路增益 時: 因此當 時,反相端電壓為 此時反相端不再是完全的虛地。
- 反相加法器利用反相端節點套用 KCL 求解輸出電壓。
(一)兩個運算放大器均為理想放大器
第一級電路
第一級為反相放大器,輸入為 ,輸入電阻為 ,回授電阻為 。
因此第一級輸出為
代入 、:
第二級電路
第二級為反相加法器,反相端接收 與 ,回授電阻為 。
由虛地及 KCL:
所以
代入 :
再代入電阻值:
因此
(二)兩個運算放大器增益均為
此小題的關鍵是不能直接使用虛地,必須使用
且題目已知輸入阻抗無限大,因此兩個運算放大器的輸入端均不取電流。
第一級:有限增益反相放大器
設第一級反相端電壓為 ,則
在第一級反相端套用 KCL:
代入 :
整理得
代入 及電阻值:
第 三 題20 分
有一個邏輯真值表如圖三所示,、、 為輸入變數, 與 為輸出函數,請將之化簡。
真值表如下:
| 0 | 0 | 0 | 0 | 1 |
| 0 | 0 | 1 | 1 | 0 |
| 0 | 1 | 0 | 1 | 1 |
| 0 | 1 | 1 | 1 | 1 |
| 1 | 0 | 0 | 1 | 0 |
| 1 | 0 | 1 | 0 | 1 |
| 1 | 1 | 0 | 0 | 1 |
| 1 | 1 | 1 | 0 | 0 |
(一) 邏輯函數為何?請繪出此邏輯函數的 static CMOS 電路圖。
🖼️【此處有附圖,請對照原卷】
(二) 邏輯函數為何?請繪出此邏輯函數的 pseudo NMOS 電路圖。
🖼️【此處有附圖,請對照原卷】
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核心觀念
本題考查:
- 由真值表寫出 Sum of Products(SOP)或 Product of Sums(POS)。
- 利用布林代數或卡諾圖化簡邏輯函數。
- Static CMOS 的設計原則:
- Pull-Down Network(PDN)由 NMOS 組成,實現反函數。
- Pull-Up Network(PUN)由 PMOS 組成,為 PDN 的對偶電路。
- Pseudo-NMOS 電路以一個閘極接地、永遠導通的 PMOS 作為上拉元件,再以 NMOS 網路實現輸出為 的條件。
(一) 邏輯函數與 static CMOS 電路
1. 由真值表寫出
的輸入組合為:
因此:
合併相鄰項:
所以:
亦可寫成:
2. 求 static CMOS 所需的反函數
Static CMOS 的 NMOS 下拉網路必須在 時導通,因此先求:
由真值表或卡諾圖化簡:
因此:
3. NMOS Pull-Down Network
因為:
所以 PDN 為三個支路並聯:
- 與 串聯,表示
- 與 串聯,表示
- 、、 三個 NMOS 串聯,表示
示意如下:
X
|
┌─────────┼─────────┐
│ │ │
NMOS NMOS NMOS
gate A gate A gate A'
| | |
NMOS NMOS NMOS
gate B gate C gate B'
| | |
└─────────┴────────NMOS gate C'
|
GND
其中左、中的兩支路及右側三顆串聯支路彼此並聯,連接於輸出 與接地之間。
4. PMOS Pull-Up Network
PUN 為 PDN 的對偶網路:
- PDN 中的串聯改為 PUN 中的並聯。
- PDN 中的並聯改為 PUN 中的串聯。
- PMOS 的閘極分別接至 或其反相訊號。
因此 PUN 結構為三個區塊串聯:
示意如下:
第 四 題20 分
有一個共源極(common-source)的 MOSFET 放大器如圖四所示,已知此 MOSFET 的 、、、、輸出端總電容 。電路中的元件:、、、、、、、、。
🖼️【此處有附圖,請對照原卷】
(一)請使用短路時間常數法(short-circuit time constant),計算出低 頻率(lower-3db frequency)。
(二)請使用開路時間常數法(open-circuit time constant),計算出上 頻率(upper 3db frequency)。
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核心觀念
本題分別使用:
-
低頻:短路時間常數法 將其他低頻電容視為短路,逐一求各電容所見電阻 ,再利用
-
高頻:開路時間常數法 將耦合電容與旁路電容視為短路,考慮 、 及 ,再利用
(一)低 頻率
1. 輸入耦合電容
偏壓電阻為
因此, 所見電阻為
其時間常數:
2. 輸出耦合電容
其他低頻電容短路,因此源極為交流接地。汲極左側電阻為
兩端所見電阻為
其時間常數:
3. 源極旁路電容
若考慮 ,源極看入 MOSFET 的等效電阻約為
所以
其時間常數:
4. 套用短路時間常數法
因此
故
(二)上 頻率
第 五 題20 分
有一個串並(series-shunt)回授放大器如圖五所示。在此我們使用一個差動放大器,此差動放大器的增益 ,輸入電阻 ,輸出電阻 。在此電路中,、。
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(一)請說明為何此電路為一個負回授電路?
(二)假設理想的回授放大器增益 ,其所需的回授因數(feedback factor) 為何?如果 , 應該為何?
(三)請畫出完整的 電路,其中 與 為(二)中所計算出之結果帶入,使用此電路計算 、 與 ,並計算出此回授放大器之實際 、 與 。
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核心觀念
本題考查電壓串聯(series-shunt)負回授放大器:
- 輸入端採「串聯混合」:回授電壓與輸入電壓相減。
- 輸出端採「並聯取樣」:由 分壓取得輸出電壓。
- 負回授基本公式:
其中:
- :基本放大器增益
- :回授因數
- :迴路增益
- :閉迴路回授增益
電壓串聯負回授會使輸入電阻增加、輸出電阻降低:
(一)為何為負回授電路
輸出電壓 經由 分壓後,回送至差動放大器的反相端。
回授電壓為
其中
差動放大器的輸入電壓為
當 增加時, 也增加;由於 加到反相端,會使差動輸入 減小,進而使輸出電壓降低。因此回授訊號抵消原輸入訊號的作用,故為負回授。
(二)求 與
理想放大器的開迴路增益極大,因此
題目給定
所以
分壓回授因數為
代入 :
因此
(三) 電路及各項參數
1. 電路
將回授訊號視為輸入端的負電壓,基本放大器輸入為
其中 、。
在計算基本放大器增益時,輸出端的負載為
故可用下列等效模型:
- 差動輸入電阻:
- 受控電壓源:
- 輸出電阻:
- 輸出負載: 的等效取樣負載
由於 串聯跨接於輸出端,因此
2. 計算基本放大器增益
輸出端等效電阻為
先算
因此
基本放大器增益為
所以